Informazioni sul prodotto | |
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| N. Articolo: 3369E-2177931 N. Art. Produtt.: 9DB106BGILF EAN/GTIN: n.d. |
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| Il buffer a ritardo zero 9DB106 di Renesas Electronics supporta i requisiti di clock PCIe Gen1 e Gen2. Il modello 9DB106 è azionato da una coppia di uscita SRC differenziale da un generatore di clock principale conforme a IDT CK410/CK505. Attenua il jitter sul clock di ingresso e dispone di una larghezza di banda PLL selezionabile per ottimizzare le prestazioni in sistemi con o senza clock a spettro esteso. Uninterfaccia SMBus consente il controllo della larghezza di banda PLL e delle opzioni di bypass, mentre 2 pin di richiesta di clock (CLKREQ n.) rendono il 9DB106 adatto per le applicazioni Express Card.Coppie di uscita differenziale in modalità di corrente (HCSL) da 6 a 0,7 V Il pin CLKREQ per le uscite 1 e 4/ supporta la scheda Express applicazioni PLL o modalità di bypass/PLL possono dejitter del clock in entrata Larghezza di banda PLL selezionabile/riduce al minimo il picco di jitter nei PLL a valle Compatibile con Spread Spectrum/clock di ingresso di spreading delle tracce per EMI ridotte Linterfaccia SMBus/le uscite inutilizzate possono essere disattivate Jitter da ciclo a ciclo < 50 ps Disallineamento uscita-uscita < 50 ps Altre informazioni: | | Numero di driver: | 6 | Tipo di ingresso: | TTL | Tipo di uscita: | Buffer | Numero di elementi per chip: | 3 | Tipo di package: | TSSOP | Numero pin: | 20 |
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| | Riepilogo condizioni1 | | | | Tempi di consegna | Stato magazzino | Prezzo | | | | | | | | a partire da € 7,294* | | | | Il prezzo è valido a partire da 3.000 pacchetti | | | | | | 1 pacchetto contiene 2 pezzi (a partire da € 3,647* per pezzo) | | | | | Scegli condizioni | | | | | | | | Prezzi progressivi | | Quantità di ordine | Netto | Lordo | Unità | | | | | | | | | | | | | | a partire da 10 pacchetti | | | | a partire da 20 pacchetti | | | | a partire da 25 pacchetti | | | | a partire da 50 pacchetti | | | | a partire da 3000 pacchetti | | | |
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